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1、
The design and implementation of an FPGA-based digital HDTV video decoder
基于FPGA的数字高清晰度电视视频解码器的设计和实现
来源：互联网摘选 -
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最后本文依照ASIC芯片设计方法对视频解码芯片预测模块进行硬件设计和仿真。
来源：互联网摘选 -
3、
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4、
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5、
A Co-design method for high-speed video decoder is present in this dissertation.
本文提出了一种高速视频解码器的软硬件协同设计方法。
来源：互联网摘选 -
6、
对于设计像MPEG4视频解码器这样复杂的系统，关键在于系统结构的设计。
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7、
A digital video decoder with high precision without using a phase locked loop
一种无锁相环的高精度数字视频彩色解码方案的研究
来源：互联网摘选 -
8、
Design and Implementation of Intra Prediction and Loop Filter in AVS Video Decoder
AVS解码器帧内预测和环路滤波器硬件设计与实现
来源：互联网摘选 -
9、
The hardware of image processing system is composed by video decoder, DSP, CPLD, etc.
硬件上构建了以视频解码芯片、DSP芯片和CPLD器件为核心的实时图像处理硬件平台；
来源：互联网摘选 -
10、
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12、
Realization and Optimization of MPEG-4 Video Decoder based on SOC
面向嵌入式系统的MPEG-4解码加速器的设计和优化
来源：互联网摘选 -
13、
Reference Frame Compression Algorithm and Hardware Design for Video Decoder
解码器中的参考帧压缩算法及其硬件设计
来源：互联网摘选 -
14、
Research and Implementation of the Video Decoder Based on Dual-Core DSPs
基于双核DSP的视频解码芯片驱动研究与实现
来源：互联网摘选 -
15、
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16、
The Hardware Implementation of Multi-channel Parallel Output in Video Decoder
视频解码器中多路并行输出的硬件实现
来源：互联网摘选 -
17、
Experiments were conducted on a video decoder chip and a wireless network processor chip.
此算法及其相关软件直接应用于视频解码芯片和无线传感器网络处理器芯片（已流片成功）的物理设计流程中。
来源：互联网摘选 -
18、
本文着重从并行处理技术为切入点对高速视频解码器并行结构的设计方法进行了深入的研究。
来源：互联网摘选 -
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Hardware Implementation of Deblocking Loop Filter in Video Decoder Chip
视频解码芯片中去块效应环路滤波的硬件实现
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